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广东农工商职业技术学院
嵌入式系统设计课程
C语言初始化系统时钟
(1)确定任务
通过在 clock.c 中定义宏 PLL_OFF ,关闭PLL 的功能,实现LED 闪烁的频率将大大降低。
(2)S5PV210 时钟体系
S5PV210 中包含 3 大类时钟 domain,分别是主系统时钟 domain (简称 MSYS,下面将使用简称来进行相关讲解)、显示相关的时钟 domain (DSYS)、外围设备的时钟 domain (PSYS)。
1) MSYS:用来给 cortex a8 处理器,dram 控制器,3D,IRAM,IROM,中断控制器等提供时钟;
2) DSYS:用来给显示相关的部件提供时钟,包括 FIMC, FIMD, JPEG, and multimedia IPs;
3) PSYS:用来给外围设备提供时钟,如i2s, spi,i2c,uart 等
GEC210外接的晶振频率(简称 Fin)为 24MHz,通过时钟控制逻辑 PLL 可以提高系统时钟。
S5PV210 共有 4 个倍频器,即 PLL,包括 APLL(供 MSYS 使用),MPLL(供 DSYS 使用),EPLL(供 PSYS使用),VPLL(供 video 相关的时钟使用)。3 大类时钟domain 中,可以使用不同的分频,使其给不同部件输出所需要的时钟,各类时钟的关系如下图:
如何确定各类时钟的值,芯片手册上给出了参考值,我们按照参考值设置即可,各类时钟的参考值如下图:
图2 S5PV210时钟设置参考值图
具体如何设置上述各种各样的时钟,可参考下图:
图3 S5PV210 时钟设置参考图
该图十分重要,依据上图我们就可以设置好所有硬件部件所需的工作时钟。
(3)软件设计
完整代码见目录 6-clock_c。
1. start.S
在调用 main 函数之前,调用了时钟初始化函数 clock_init,进行时钟相关的设置。
.global _start
_start:
// 关闭看门狗
ldr r0, =0xE2700000
mov r1, #0
str r1, [r0]
// 设置栈,以便调用c函数
ldr sp, =0
// 汇编初始化时钟
bl clock_init
// 调用main函数
bl main
halt:
b halt
2. clock.c
// 时钟相关寄存器
#define APLL_LOCK ( *((volatile unsigned long *)0xE0100000) )
#define MPLL_LOCK ( *((volatile unsigned long *)0xE0100008) )
#define APLL_CON0 ( *((volatile unsigned long *)0xE0100100) )
#define APLL_CON1 ( *((volatile unsigned long *)0xE0100104) )
#define MPLL_CON ( *((volatile unsigned long *)0xE0100108) )
#define CLK_SRC0 ( *((volatile unsigned long *)0xE0100200) )
#define CLK_SRC1 ( *((volatile unsigned long *)0xE0100204) )
#define CLK_SRC2 ( *((volatile unsigned long *)0xE0100208) )
#define CLK_SRC3 ( *((volatile unsigned long *)0xE010020c) )
#define CLK_SRC4 ( *((volatile unsigned long *)0xE0100210) )
#define CLK_SRC5 ( *((volatile unsigned long *)0xE0100214) )
#define CLK_SRC6 ( *((volatile unsigned long *)0xE0100218) )
#define CLK_SRC_MASK0 ( *((volatile unsigned long *)0xE0100280) )
#define CLK_SRC_MAS
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