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期末考试试卷二 一、填空（每空 1 分，计 20 分） 1、计数器按增减趋势分有 、  和  计数器。 2、TTL 与非门输入级由 一起称为 。 组成。两个 OC 门输出端直接接在 3、在 TTL 与非门，异或门，集电级开路门，三态门中，为实现线与逻辑功 能应选用 ，要有推拉式输出级，又要能驱动总线应选 用 门。 一个触发器可以存放 优先编码器的编码输出为 位二进制数。 码，如编码输出 A2A1A0=011，可知 对输入的 进行编码。 6、逻辑函数的四种表示方法是 、 、 、 。 7、移位寄存器的移位方式有 ， 和 。 8、同步 RS 触发器中，R，S 为 R，S  电平有效，基本 RS 触发器中 为 电平有效。 9 、 常 见 的 脉 冲 产 生 电 路 有 二.判断题：（每题 1 分，共 10 分） 对于 JK 触发器 J=K=1 时，输出翻转。 （ ） 一个存储单元可存 1 位 2 进制数。 （ ） 同一 CP 控制各触发器的计数器称为异步计数器。 （ ） 对 MOS 门电路多余端不可以悬空。 （ ） 函数式 F=ABC+AB C +A B C= ?（3、5、6、7） （ ） JK 触发器的输入端 J 悬空，相当于 J=1。 （ ） 时序电路的输出状态仅与此刻输入变量有关。 （ ） 一个触发器能存放一位二进制数。 （ ） 计数器随 CP 到来计数增加的称加计数器。 （ ） 数字电路中用“1”和“0”分别表示两种状态,二者无大小之分。（ ） 三、选择题（每题 1 分，共 10 分） 1、对于 MOS 门电路，多余端不允许（ ） A、悬空 C、接电源 2、右图①表示（ ）电路， ②图表示（ ）电路 Ａ、与门 Ｂ、或门 Ｃ、非门 Ｄ、与非门 B、与有用端并联 D、接低电平 ３、卡诺图③、④表示的逻辑函数最简式分别为（ ）和（ ） A、F= B + D F=B+D F=BD+ B D F=BD+ BD 4、逻辑电路如图⑤，函数式为（  ） F= AB + C F= A B + C F= AB +C D、F=A+B C 5、一 位 8 4 2 1 B C D 码 计 数 器 至 少 需 要  个 触 发 器 。 B A . 3 B . 4 C . 5 D . 1 0 6、下列逻辑函数表达式中与 F=A B + A B 功能相同的是（ ）A A、 A ? B B、 A ? B C、 A ? B D、 A ? B 7、施密特触发器常用于（ ） A、脉冲整形与变换 C、计数 8、施密特触发器的输出状态有  B、定时、延时 D、寄存 A、一个稳态、一个暂态 C、只有一个稳态 四、逻辑函数化简（10 分） B、两个稳态 D、没有稳态 1、用公式法化简下列函数 F=AD+ B C+B D +A(B+ C )+ A BC D + A B DE 2、用卡诺图法化简下列函数 F= ?m(1、3，8，9，10，11，14，15) 五、画波形图（共 5 分） 1、边沿型 JK 触发器的输入波形如图所示，画出 Q 端的波形。设触发器的 初始状态为“ 1 ”。 六、分析设计题（共 25 分） 1.分析右图 8 选 1 数据选择器的构成电路，写出其逻辑表达式。（5 分） 2.试用 74LS138 和适当门电路实现逻辑函数 L（A、B、C） =（0、2、3、4、7） （10 分） 3.分别用方程式、状态转换图表示如图所示电路的功能。 （10 分） 七、数制转换 （每空 2 分，共 10 分） （1）、（1100011.011）2=( )16=( ) 8 （2）、 (100001)2= ( ) 10 （3）、（156） 10 =( )2 =( )8421BCD 八、下图是 555 定时器构成的施密特触发器，已知电源电压 V  CC  =12V ，求： 1.电路的 V T+ ， V T- 和 ?V T 各为多少？ 如果输入电压波形如图，试画出输出 v o 的波形。 若控制端接至 +6V ，则电路的 V T+ ， V T- 和 ?V T 各为多少？ （10 分） 答案 一、填空题 1、加法计数器、减法计数器、加/减计数器 2.多发射极三极管和电阻、线与 集电级开路门、三态门 1 二进制码 十进制数 3 逻辑表达式 逻辑图 真值表 卡诺图 7.左移 、右移 双向移位 高 低 多谐振荡器 二、判断题： 1. × 2.√ 3. × 4.√ 5. × 6 √ 7.× 8. √ 9. √ 10.√ 三、选择题 1.A 2.A B 3. C B 4.A 5.B 6 . A 7 . A 8 . B 四、逻辑函数化简 F=A+ B C+B D F=A B +AC+ B D 五、画波形图 六、分析设计题 1. F=