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实验八4X4keyboard实验
一、实验目的
(1)学习QuartusⅡ9.0的基本操作。
(2)熟悉教学实验箱的使用。
(3)初步掌握Verilog语言程序的设计输入,编译,仿真和调试过程。
二、实验原理
利用行列式扫描原理编写Verilog语言程序对4X4键盘进行扫描,并将扫描值送LED显示。
三、实验步骤
1、建立工程
运行QuatrusII软件,建立工程(key.qpf)。
2、建立文本文件
建立文本文件。File→New,选择VerilogHDLFile。
输入下述程序:
modulekeyboard(clk,row,col,key);
inputclk; //50MHZ时钟输入
input[3:0]col; //列
output[3:0]row; //行
output[3:0]key; //按键值
reg[3:0]row;
reg[3:0]key;
reg[5:0]count; //时钟计数器
reg[2:0]state; //状态标志
regkey_flag; //按键标志位
regclk_500khz; //500KHZ时钟信号
reg[3:0]row_reg; //寄存扫描行值
reg[3:0]col_reg; //寄存扫描列值
always@(posedgeclk) //500KHZ扫描时钟信号
if(count=50)
begin
clk_500khz=~clk_500khz;
count=0;
end
elsecount=count+1;
always@(posedgeclk_500khz)
case(state)
0:
begin
key_flag=1b0; //清按键标志
row[3:0]=4b0000; //行线全部拉低,确定有没有按键被按下
if(col[3:0]!=4b1111) //有键按下(列线有被拉低,数据出现不全1)
begin
row[3:0]=4b0111; //扫描第0行(第0行线拉低)
state=1;//转到第1状态,扫描第0行
end
elsestate=0;//没有键按下,返回case0,重新扫描
end
1:
begin
if(col[3:0]!=4b1111)//第0行有键按下(列线有被拉低,数据出现不全1)
state=5;//转到第5状态,保存行列信息
else
begin
row[3:0]=4b1011;//扫描第1行(第1行线拉低)
state=2;//转到第2状态,扫描第1行
end
end
2:
begin
if(col[3:0]!=4b1111)//第1行有键按下(列线有被拉低,数据出现不全1)
state=5;//转到第5状态,保存行列信息
else
begin
row[3:0]=4b1101;//扫描第2行(第2行线拉低)
state=3;//转到第3状态,扫描第2行
end
end
3:
begin
if(col[3:0]!=4b1111)//第2行有键按下(列线有被拉低,数据出现不全1)
state=5;//转到第5状态,保存行列信息
else
begin
row[3:0]=4b1110;//扫描第3行(第3行线拉低)
state=4;//转到第4状态,扫描第3行
end
end
4:
begin
if(col[3:0]!=4b1111)//第3行有键按下(列线有被拉低,数据出现不全1)
state=5;//转到第5状态,保存行列信息
else
state=0;//没有键按下,返回case0,重新扫描
end
5:
begin
if(col[3:0]!=4b1111)//(列线有被拉低,数据出现不全1,说明按键没松开)
begin
row_reg=row;//保存扫描列值
col_reg=col;//保存扫描行值
key_flag=1b1;//有键按下状态标志
state=5;//返回状态5。(等待按键松开)
end
else
state=0;
end
endcase
always@
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