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关于期货行情数据加速处理中基于FPGA的DDR3六通道读写防冲突设计详解 0引言 基于FPGA的期货行情数据加速处理过程中,不同的消息类型采用并行处理的方式,并且每一次的处理结果需要使用内存来缓存一次行情数据信息。行情数据信息容量巨大,片上存储难以满足需求,采用DDR3S(DRAM)成为首选方法。但由于DDR3只有一套数据访问通道,不能满足多个通道同时访问的需求。此前的对于SD(RAM)的多通道解决方案中,比如曹一江等设计的基于N(PI)总线的片外存储器,最大带宽可达743Mb/s;樊博等使用UI接口,DDR3通信的最大带宽可达3.8Gb/s;张宇嘉等设计的基于AXI4的DDR3多端口方案虽

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